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CI840A 3BSE041882R1 卡件

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CI840A 3BSE041882R1 卡件
Emerson, PR9376/010-011   pcs 1

 

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并行結構是將1條數據通路的工作分解到2條通路上完成。并行結構降低功耗的主要原因是其獲得與參考結構相同的計算速度的前提下,其工作頻率可以降低為原來的1/2,同時電源電壓也可降低。并行電路結構是以犧牲芯片的面積來降低功耗。如果采用并行結構,可以使工作頻率降為 /2,最壞情況下的延遲可以達到2 ,假定電源電壓降低為 /1.8,由于電路的加倍和外部布線的增加,其等效的電容為2 。

電路流水就是采用插人寄存器的辦法降低組合路徑的長度,達到降低功耗的目的。一個先相加再比較的電路中間插人流水線寄存器的流水結構。加法器和選擇器處在2條不同的組合路徑上,電路的工作頻率沒有改變,但每一級的電路減少,使電源電壓可以降低。假設電源電壓為 /1.8,由于加入了流水線寄存器,等效電容變?yōu)樵瓉淼?.2 。則:由上式可見,采用流水線結構也可以顯著地降低功耗。

電路流水化和并行化可以達到降低功耗的目的,這是因為設計者可以選擇電路的工作電壓。如果電路工作電壓固定,2種方法只能提高電路的工作速度,但功耗將相應地有所增加。

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